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具有外部按钮执行逻辑分析仪取样功能 |
在孕龙逻辑分析仪的硬件上,有一个START的按钮,当逻辑分析仪软件在开启的状态,可利用此按钮来让逻辑分析仪执行取样的动作。此按钮能让您更快速的操作逻辑分析仪取得被测物的资料。 |
压缩技术 |
孕龙科技推出波行压缩专利技术,可以在不增加内存的状况下获取更长的波形资料。For Example:设定内存深度为1M,取样率为50MHz。未开启压缩功能时仅可撷取20.972ms,若开启压缩功能后,以同样记忆深度为1M,取样率为50MHz进行取样,则可以将波形时间增加至3.999s,大大的提升了撷取数据量。 |
信号滤波延迟 |
触发分页技术 |
触发次数计算 |
孕龙逻辑分析仪加入了触发次数计算(Trigger Counter)的技术,Trigger Counter,的功能是将有一个以上符合触发值的被测信号,使用者可决定触发点是要在第几个符合触发设定的位置进行触发, 第一次碰到触发的设定状态时就触发Trigger Counter就要设定为1(预设),第三次碰到触发的设定状态时才触发Trigger Counter就要设定为3,依此类推。 |
内存分析 |
孕龙逻辑分析仪加入了内存分析功能(Memory Analyzer),针对总线中有使用ADDRESS的类别,如IIC、HDQ、3-WIRE、PM、SM、IIC(EEPROM 24LX)…等等,能够将总线中的ADDRESS、READ/WRITE、DATA状态记录于内存分析表中,让使用者进行总线分析时也能够针对ADDRESS、READ/WRITE、DATA加以记录分析。 |
总线协议分析实例 – IIS总线协议分析译码 |
孕龙科技的I2S总线分析模块,可帮助使用者进行I2S总线分析,透过译码模块可将讯号中的Data-L及Data-R数值直接显示于屏幕上,孕龙科技IIS总线分析模块可依照待测I2S讯号格式让使用者选择Data bit长度为16、20、24、32 bits,方便使用者面对各种不同的I2S讯号均能顺利分析。 |
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